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A fully integrated CMOS frequency synthesizer with charge-averaging charge pump and dual-path loop filter for PCS- and cellular-CDMA wireless systems
IEEE journal of solid-state circuits, 2002-05, Vol.37 (5), p.536-542
2002
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Full-CMOS 2-GHz WCDMA direct conversion transmitter and receiver
IEEE journal of solid-state circuits, 2003-01, Vol.38 (1), p.43-53
2003
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A 0.25-/spl mu/m CMOS quad-band GSM RF transceiver using an efficient LO frequency plan
IEEE journal of solid-state circuits, 2005-05, Vol.40 (5), p.1094-1106
2005
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Comparison frequency doubling and charge pump matching techniques for dual-band /spl Delta//spl Sigma/ fractional-N frequency synthesizer
IEEE journal of solid-state circuits, 2005-11, Vol.40 (11), p.2228-2236
2005
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An image resolution enhancing technique using adaptive sub-pixel interpolation for digital still camera system
IEEE transactions on consumer electronics, 1999-02, Vol.45 (1), p.118-123
1999
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Comparison frequency doubling and charge pump matching techniques for dual-band ΔΣ fractional-N frequency synthesizer
IEEE journal of solid-state circuits, 2005-11, Vol.40 (11), p.2228-2236
2005
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A 0.25-[micro]m CMOS quad-band GSM RF transceiver using an efficient LO frequency plan
IEEE journal of solid-state circuits, 2005-05, Vol.40 (5), p.1094
2005
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A 0.25-μm CMOS quad-band GSM RF transceiver using an efficient LO frequency plan
IEEE journal of solid-state circuits, 2005-05, Vol.40 (5), p.1094-1106
2005
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Comparison frequency doubling and charge pump matching techniques for dual-band [Delta][Sigma] fractional-N frequency synthesizer
IEEE journal of solid-state circuits, 2005-11, Vol.40 (11), p.2228
2005
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Comparison frequency doubling and charge pump matching techniques for dual-band Delta capital sigma fractional-N frequency synthesizer
IEEE journal of solid-state circuits, 2005-01, Vol.40 (11)
2005
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A CMOS dual-band fractional-n synthesizer with reference doubler and compensated charge pump
2004 IEEE International Solid-State Circuits Conference (IEEE Cat. No.04CH37519), 2004, p.100-516 Vol.1
First edition, 2004
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A 4-400 MHz jitter-suppressed delay-locked loop with frequency division method
ICVC '99. 6th International Conference on VLSI and CAD (Cat. No.99EX361), 1999, p.339-341
1999
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A semi-digital delay locked loop for clock skew minimization
Proceedings Twelfth International Conference on VLSI Design. (Cat. No.PR00013), 1999, p.584-588
1999
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A high-speed memory interface circuit tolerant to PVT variations and channel noise
Proceedings of the 27th European Solid-State Circuits Conference, 2001, p.293-296
2001
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Full-CMOS 2.4 GHz wideband CDMA transmitter and receiver with direct conversion mixers and DC-offset cancellation
2001 Symposium on VLSI Circuits. Digest of Technical Papers (IEEE Cat. No.01CH37185), 2001, p.7-10
2001
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A fully-integrated CMOS frequency synthesizer with charge-averaging charge pump and dual-path loop filter for PCS- and cellular-CDMA wireless systems
2001 Symposium on VLSI Circuits. Digest of Technical Papers (IEEE Cat. No.01CH37185), 2001, p.43-46
2001
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