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A 6-Gbps 16-nm FinFET CMOS I/O Buffer With Variation Insensitivity Ensured by Genetic Algorithm
IEEE transactions on circuits and systems. I, Regular papers, 2024-07, p.1-12
2024
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A 2.6-GHz I/O Buffer for DDR4 & DDR5 SDRAMs in 16-nm FinFET CMOS Process
2023 IEEE Asia Pacific Conference on Circuits and Systems (APCCAS), 2023, p.271-275
2023
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GA-Optimized 6.0-Gbps DDR5 SDRAM I/O Buffer Design for 16-nm FinFET CMOS Process
2024 IEEE 6th International Conference on AI Circuits and Systems (AICAS), 2024, p.95-99
2024
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A 266.7 TOPS/W Computing-in Memory Using Single-Ended 6T 4-kb SRAM in 16-nm FinFET CMOS Process
2024 IEEE 6th International Conference on AI Circuits and Systems (AICAS), 2024, p.90-94
2024
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A 500-MHz 32-bit DETFF-based Shift Register Utilizing 40-nm CMOS Technology
2022 IEEE Asia Pacific Conference on Circuits and Systems (APCCAS), 2022, p.251-255
2022
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HyLo: Implementation of LoRaWAN in an Automated Hydroponics System
2021 IEEE International Conference on Mobile Networks and Wireless Communications (ICMNWC), 2021, p.1-6
2021
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