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A Highly Linear OTA-Less 1-1 MASH VCO-Based \Delta\Sigma ADC With an Efficient Phase Quantization Noise Extraction Technique
IEEE journal of solid-state circuits, 2020-03, Vol.55 (3), p.706-718
2020
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Open Access
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A 0.49-13.3 MHz Tunable Fourth-Order LPF with Complex Poles Achieving 28.7 dBm OIP3
IEEE transactions on circuits and systems. I, Regular papers, 2018-08, Vol.65 (8), p.2353-2364
2018
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A Highly Linear OTA-Free VCO-Based 1-1 MASH \Delta\Sigma ADC
IEEE transactions on circuits and systems. I, Regular papers, 2019-07, Vol.66 (7), p.2440-2453
2019
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A Highly Linear OTA-Less 1-1 MASH VCO-Based [Formula Omitted] ADC With an Efficient Phase Quantization Noise Extraction Technique
IEEE journal of solid-state circuits, 2020-01, Vol.55 (3), p.706
2020
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A Highly Linear OTA-Free VCO-Based 1-1 MASH [Formula Omitted] ADC
IEEE transactions on circuits and systems. I, Regular papers, 2019-01, Vol.66 (7), p.2440
2019
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A 72.4-dB SNDR 92-dB SFDR Blocker Tolerant CT \Delta\Sigma Modulator With Inherent DWA
IEEE transactions on circuits and systems. II, Express briefs, 2019-03, Vol.66 (3), p.347-351
2019
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A 72.4-dB SNDR 92-dB SFDR Blocker Tolerant CT [Formula Omitted] Modulator With Inherent DWA
IEEE transactions on circuits and systems. II, Express briefs, 2019-01, Vol.66 (3), p.347
2019
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Digital Correction of DAC Nonlinearity in Multi-Bit Feedback A/D Converters: Invited tutorial
2020 IEEE Custom Integrated Circuits Conference (CICC), 2020, p.1-8
2020
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An Amplifier-Free 0-2 SAR-VCO MASH ΔΣ ADC
2019 IEEE International Symposium on Circuits and Systems (ISCAS), 2019, p.1-5
2019
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A Novel Time-Domain Phase Quantization Noise Extraction for a VCO-based Quantizer
2018 IEEE 61st International Midwest Symposium on Circuits and Systems (MWSCAS), 2018, p.145-148
2018
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0.9V, 79.7dB SNDR, 2MHz-BW, Highly linear OTA-less 1-1 MASH VCO-based ΔΣ with a Novel Phase Quantization Noise Extraction Technique
2019 IEEE Custom Integrated Circuits Conference (CICC), 2019, p.1-4
2019
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A passive CMOS low-pass filter for high speed and high SNDR applications
2015 IEEE International Symposium on Circuits and Systems (ISCAS), 2015, p.285-288
2015
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  • BibTeX
A noise-coupled time-interleaved delta-sigma modulator with shifted loop delays
2015 IEEE International Symposium on Circuits and Systems (ISCAS), 2015, p.2045-2048
2015
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Sequential interstage correlated double sampling: A switched-capacitor technique for high accuracy systems
2014 IEEE 57th International Midwest Symposium on Circuits and Systems (MWSCAS), 2014, p.262-265
2014
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Multi-step counting ADC
2014 IEEE 57th International Midwest Symposium on Circuits and Systems (MWSCAS), 2014, p.17-20
2014
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A 4mW 3-tap 10 Gb/s decision feedback equalizer
2011 IEEE 54th International Midwest Symposium on Circuits and Systems (MWSCAS), 2011, p.1-4
2011
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A highly linear OTA-free VCO-based 1-1 MASH ΔΣ ADC
2017 IEEE International Symposium on Circuits and Systems (ISCAS), 2017, p.1-4
2017
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A 12.5 Gb/s 6.6 mW receiver with analog equalizer and 1-tap DFE
Microelectronics, 2012-12, Vol.43 (12), p.1029-1037
2012
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A 12.5Gb/s 6.6mW receiver with analog equalizer and 1-tap DFE
Microelectronics, 2012-12, Vol.43 (12), p.1029-1037
2012
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A low power 9.5 ENOB 100MS/s pipeline ADC using correlated level shifting
2011 24th Canadian Conference on Electrical and Computer Engineering(CCECE), 2011, p.001379-001382
2011
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A 12.5Gb/s active-inductor based transmitter for I/O applications
2011 20th European Conference on Circuit Theory and Design (ECCTD), 2011, p.186-189
2011
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High speed CML latch using active inductor in 0.18μm CMOS technology
2011 19th Iranian Conference on Electrical Engineering, 2011, p.1-4
2011
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