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9.2 A 2.08mW 64.4dB SNDR 400MS/s 12b Pipelined-SAR ADC using Mismatch and PVT Variation Tolerant Dynamically Biased Ring Amplifier in 8nm
2024 IEEE International Solid-State Circuits Conference (ISSCC), 2024, Vol.67, p.170-172
2024
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9.6 A 6th-Order Quadrature CTDSM using Double-OTA and Quadrature NSSAR with 171.3dB FoMs in 14nm
2024 IEEE International Solid-State Circuits Conference (ISSCC), 2024, Vol.67, p.178-180
2024
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A dual 10-b 200-MSPS pipelined D/A converter with DLL-based clock synthesizer
IEEE journal of solid-state circuits, 2004-11, Vol.39 (11), p.1829-1838
2004
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A 15-b, 5-Msample/s low-spurious CMOS ADC
IEEE journal of solid-state circuits, 1997-12, Vol.32 (12), p.1866-1875
1997
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A 15 b 5 MSample/s low-spurious CMOS ADC
1997 IEEE International Solids-State Circuits Conference. Digest of Technical Papers, 1997, Vol.40, p.146-147
1997
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A 10A/μs Fast Transient AOT Voltage Regulator on DDR5 DIMM with Dithered Pseudo-Constant Switching Frequency Achieving -6dB Harmonic Suppression
2021 Symposium on VLSI Circuits, 2021, p.1-2
2021
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A behavioral modeling approach to the design of a low jitter clock source
IEEE transactions on circuits and systems. 2, Analog and digital signal processing, 2003-11, Vol.50 (11), p.804-814
2003
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A 4-nm 16-Gb/s/pin Single-Ended PAM-4 Parallel Transceiver With Switching-Jitter Compensation and Transmitter Optimization
IEEE journal of solid-state circuits, 2024-01, Vol.59 (1), p.184-195
2024
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Zero Current Detector with Slope Judgement Calibration in Mobile Battery Charger IC
2021 IEEE Asian Solid-State Circuits Conference (A-SSCC), 2021, p.1-3
2021
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A 10-b 20-Msample/s low-power CMOS ADC
IEEE journal of solid-state circuits, 1995-05, Vol.30 (5), p.514-521
1995
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A 1.05-A/m Minimum Magnetic Field Strength Single-Chip, Fully Integrated Biometric Smart Card SoC Achieving 792.5-ms Transaction Time With Anti-Spoofing Fingerprint Authentication
IEEE journal of solid-state circuits, 2023-01, Vol.58 (1), p.1-12
2023
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A Reconfigurable Series-Parallel Charger for Dual-Battery Applications with 89W 97.7% Efficiency in Direct Charging Mode
2022 IEEE International Solid- State Circuits Conference (ISSCC), 2022, Vol.65, p.476-478
2022
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A 1.05A/m Minimum Magnetic Field Strength Single-Chip Fully Integrated Biometric Smart Card SoC Achieving 1014.7ms Transaction Time with Anti-Spoofing Fingerprint Authentication
2022 IEEE International Solid- State Circuits Conference (ISSCC), 2022, Vol.65, p.504-506
2022
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15-B, 5-MSample/S low-spurious CMOS ADC
Computer standards and interfaces, 1999-06, Vol.21 (2), p.105-105
1999
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Low-spurious analog-to-digital conversion using multi-stage code-error calibration
1997
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A 14 b 40 MSample/s pipelined ADC with DFCA
2001 IEEE International Solid-State Circuits Conference. Digest of Technical Papers. ISSCC (Cat. No.01CH37177), 2001, p.136-137
2001
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Design of a 14 b 100 MS/s switched-capacitor pipelined ADC in RFSiGe BiCMOS
ISCAS 2001. The 2001 IEEE International Symposium on Circuits and Systems (Cat. No.01CH37196), 2001, Vol.1, p.428-431 vol. 1
2001
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