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256 Gb 3 b/Cell V-nand Flash Memory With 48 Stacked WL Layers
IEEE journal of solid-state circuits, 2017-01, Vol.52 (1), p.210-217
2017
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Open Access
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Endoscopic Treatment of Intussusception due to Intestinal Tuberculosis
Clinical Endoscopy, 2017, 50(2), , pp.206-208
2017
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Layout-driven architecture synthesis for high-speed digital filters
IEEE transactions on very large scale integration (VLSI) systems, 2006-02, Vol.14 (2), p.203-207
2006
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A flash memory controller for 15μs ultra-low-latency SSD using high-speed 3D NAND flash with 3μs read time
2018 IEEE International Solid - State Circuits Conference - (ISSCC), 2018, p.338-340
2018
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A 1.8-Gb/s/Pin 16-Tb NAND Flash Memory Multi-Chip Package With F-Chip for High-Performance and High-Capacity Storage
IEEE journal of solid-state circuits, 2021-04, Vol.56 (4), p.1129-1140
2021
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A 1Tb 3b/Cell 8th-Generation 3D-NAND Flash Memory with 164MB/s Write Throughput and a 2.4Gb/s Interface
2022 IEEE International Solid- State Circuits Conference (ISSCC), 2022, Vol.65, p.136-137
2022
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Open Access
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Novel molecular and nanosensors for in vivo sensing
Theranostics, 2013-01, Vol.3 (8), p.583-594
2013
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A 3.0 Gb/s/pin 4th generation F-chip with Toggle 5.0 Specification for 16Tb NAND Flash Memory Multi chip Package
2023 IEEE Symposium on VLSI Technology and Circuits (VLSI Technology and Circuits), 2023, p.1-2
2023
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Endoscopic Treatment of Intussusception due to Intestinal Tuberculosis
Clinical endoscopy, 2017-03, Vol.50 (2), p.206
2017
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13.1 A 1Tb 4b/cell NAND Flash Memory with tPROG=2ms, tR=110µs and 1.2Gb/s High-Speed IO Rate
2020 IEEE International Solid- State Circuits Conference - (ISSCC), 2020, p.218-220
2020
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13.4 A 512Gb 3-bit/Cell 3D 6th-Generation V-NAND Flash Memory with 82MB/s Write Throughput and 1.2Gb/s Interface
2019 IEEE International Solid- State Circuits Conference - (ISSCC), 2019, p.216-218
2019
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7.1 256Gb 3b/cell V-NAND flash memory with 48 stacked WL layers
2016 IEEE International Solid-State Circuits Conference (ISSCC), 2016, p.130-131
2016
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A Hybrid Temperature Compensation method combined with Digital and Analog Temperature Compensation Techniques for 3D-NAND Flash Memories
2022 IEEE Asian Solid-State Circuits Conference (A-SSCC), 2022, p.1-2
2022
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Low -power and layout -aware data-path synthesis for nanometer technology
2004
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A Comparison between 63nm 8Gb and 90nm 4Gb Multi-Level Cell NAND Flash Memory for Mass Storage Application
2005 IEEE Asian Solid-State Circuits Conference, 2005, p.13-16
2005
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Power supply noise-aware scheduling and allocation for DSP synthesis
Sixth international symposium on quality electronic design (isqed'05), 2005, p.48-53
2005
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A 1.8 Gb/s/pin 16Tb NAND Flash Memory Multi-Chip Package with F-Chip of Toggle 4.0 Specification for High Performance and High Capacity Storage Systems
2020 IEEE Symposium on VLSI Circuits, 2020, p.1-2
2020
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Floorplan-aware low-complexity digital filter synthesis for low-power & high-speed
IEEE International Conference on Computer Design: VLSI in Computers and Processors, 2004. ICCD 2004. Proceedings, 2004, p.354-357
2004
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Open Access
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Prioritization of Hazardous Zones Using an Advanced Risk Management Model Combining the Analytic Hierarchy Process and Fuzzy Set Theory
Sustainability, 2023-08, Vol.15 (15), p.12018
2023
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Unidirectional Real-Time Photoswitching of Diarylethene Molecular Monolayer Junctions with Multilayer Graphene Electrodes
ACS applied materials & interfaces, 2019-03, Vol.11 (12), p.11645-11653
2019
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New Tunnel Risk Assessment Model Combining Ahp and Fuzzy Set Theory
SSRN Electronic Journal
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