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A low-voltage, low-power CMOS delay element
IEEE journal of solid-state circuits, 1996-07, Vol.31 (7), p.966-971
1996
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A 5-Gb/s 0.25-/spl mu/m CMOS jitter-tolerant variable-interval oversampling clock/data recovery circuit
IEEE journal of solid-state circuits, 2002-12, Vol.37 (12), p.1822-1830
2002
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A 4-400 MHz jitter-suppressed delay-locked loop with frequency division method
ICVC '99. 6th International Conference on VLSI and CAD (Cat. No.99EX361), 1999, p.339-341
1999
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