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A Single-Pair Serial Link for Mobile Displays With Clock Edge Modulation Scheme
IEEE journal of solid-state circuits, 2007-09, Vol.42 (9), p.2012-2020
2007
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A 5-Gb/s 0.25-μm CMOS jitter-tolerant variable-interval oversampling clock/data recovery circuit
IEEE journal of solid-state circuits, 2002-12, Vol.37 (12), p.1822-1830
2002
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A 1.2-V-only 900-mW 10 gb ethernet transceiver and XAUI interface with robust VCO tuning technique
IEEE journal of solid-state circuits, 2005-11, Vol.40 (11), p.2148-2158
2005
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A 2.5-10-Gb/s CMOS transceiver with alternating edge-sampling phase detection for loop characteristic stabilization
IEEE journal of solid-state circuits, 2003-11, Vol.38 (11), p.1821-1829
2003
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A 3-mW, 270-Mbps, Clock-Edge Modulated Serial Link for Mobile Displays
2005 IEEE Asian Solid-State Circuits Conference, 2005, p.45-48
2005
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A 5-Gb/s 0.25-/spl mu/m CMOS jitter-tolerant variable-interval oversampling clock/data recovery circuit
IEEE journal of solid-state circuits, 2002-12, Vol.37 (12), p.1822-1830
2002
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A 2.5-10Gb/s CMOS transceiver with alternating edge sampling phase detection for loop characteristic stabilization
2003 IEEE International Solid-State Circuits Conference, 2003. Digest of Technical Papers. ISSCC, 2003, p.76-479 vol.1
2003
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Circuit techniques for a 40Gb/s transmitter in 0.13/spl mu/m CMOS
ISSCC. 2005 IEEE International Digest of Technical Papers. Solid-State Circuits Conference, 2005, 2005, p.150-589 Vol. 1
2005
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A fully integrated 0.13 /spl mu/m CMOS 10 Gb Ethernet transceiver with XAUI interface
2004 IEEE International Solid-State Circuits Conference (IEEE Cat. No.04CH37519), 2004, p.170-520 Vol.1
2004
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A quad 3.125 Gbps transceiver cell with all-digital data recovery circuits
Digest of Technical Papers. 2005 Symposium on VLSI Circuits, 2005, 2005, p.384-387
2005
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A 5Gb/s 0.25/spl mu/m CMOS jitter-tolerant variable-interval oversampling clock/data recovery circuit
2002 IEEE International Solid-State Circuits Conference. Digest of Technical Papers (Cat. No.02CH37315), 2002, Vol.2, p.206-474
2002
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A 5 Gb/s 0.25 /spl mu/m CMOS jitter-tolerant variable-interval oversampling clock/data recovery circuit
2002 IEEE International Solid-State Circuits Conference. Digest of Technical Papers (Cat. No.02CH37315), 2002, Vol.1, p.256-465 vol.1
2002
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